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| version 1.1, 2003/12/08 00:55:31 | version 1.4, 2004/01/23 14:33:26 |
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| Line 34 | Line 34 |
| extern "C" { | extern "C" { |
| #endif | #endif |
| /* | |
| * ページ・ディレクトリ・エントリ (4K バイトページ使用時) | |
| * | |
| * 31 12 11 9 8 7 6 5 4 3 2 1 0 | |
| * +----------------------------------------+------+-+--+-+-+---+---+---+---+-+ | |
| * | ページ・テーブルのベース・アドレス |使用可|G|PS|0|A|PCD|PWT|U/S|R/W|P| | |
| * +----------------------------------------+------+-+--+-+-+---+---+---+---+-+ | |
| * | | | | | | | | | | | |
| * 9-11: システム・プログラマが使用可能 --------+ | | | | | | | | | | |
| * 8: グローバル・ページ(無視される) ------------+ | | | | | | | | | |
| * 7: ページ・サイズ (0 = 4k バイトページ) ---------+ | | | | | | | | |
| * 6: 予約 (0) ---------------------------------------+ | | | | | | | |
| * 5: アクセス -----------------------------------------+ | | | | | | |
| * 4: キャッシュ無効 --------------------------------------+ | | | | | |
| * 3: ライトスルー --------------------------------------------+ | | | | |
| * 2: ユーザ/スーパバイザ (0 = スーパバイザ) ---------------------+ | | | |
| * 1: 読み取り/書き込み (0 = 読み取りのみ) ---------------------------+ | | |
| * 0: ページ存在 ---------------------------------------------------------+ | |
| */ | |
| #define CPU_PDE_BASEADDR_MASK 0xfffff000 | |
| #define CPU_PDE_PAGE_SIZE (1 << 7) | |
| #define CPU_PDE_ACCESS (1 << 5) | |
| #define CPU_PDE_CACHE_DISABLE (1 << 4) | |
| #define CPU_PDE_WRITE_THROUGH (1 << 3) | |
| #define CPU_PDE_USER_MODE (1 << 2) | |
| #define CPU_PDE_WRITABLE (1 << 1) | |
| #define CPU_PDE_PRESENT (1 << 0) | |
| /* | |
| * ページ・ディレクトリ・エントリ (4M バイトページ使用時) | |
| * | |
| * 31 22 21 12 11 9 8 7 6 5 4 3 2 1 0 | |
| * +----------------------------+-----------+------+-+--+-+-+---+---+---+---+-+ | |
| * |ページテーブルの物理アドレス| 予約済み |使用可|G|PS|D|A|PCD|PWT|U/S|R/W|P| | |
| * +----------------------------+-----------+------+-+--+-+-+---+---+---+---+-+ | |
| * | | | | | | | | | | | |
| * 9-11: システム・プログラマが使用可能 --------+ | | | | | | | | | | |
| * 8: グローバル・ページ ------------------------+ | | | | | | | | | |
| * 7: ページ・サイズ (1 = 4M バイトページ) ---------+ | | | | | | | | |
| * 6: ダーティ ---------------------------------------+ | | | | | | | |
| * 5: アクセス -----------------------------------------+ | | | | | | |
| * 4: キャッシュ無効 --------------------------------------+ | | | | | |
| * 3: ライトスルー --------------------------------------------+ | | | | |
| * 2: ユーザ/スーパバイザ (0 = スーパバイザ) ---------------------+ | | | |
| * 1: 読み取り/書き込み (0 = 読み取りのみ) ---------------------------+ | | |
| * 0: ページ存在 ---------------------------------------------------------+ | |
| */ | |
| #define CPU_PDE_4M_BASEADDR_MASK 0xffc00000 | |
| #define CPU_PDE_4M_GLOBAL_PAGE (1 << 8) | |
| #define CPU_PDE_4M_PAGE_SIZE (1 << 7) | |
| #define CPU_PDE_4M_DIRTY (1 << 6) | |
| #define CPU_PDE_4M_ACCESS (1 << 5) | |
| #define CPU_PDE_4M_CACHE_DISABLE (1 << 4) | |
| #define CPU_PDE_4M_WRITE_THROUGH (1 << 3) | |
| #define CPU_PDE_4M_USER_MODE (1 << 2) | |
| #define CPU_PDE_4M_WRITABLE (1 << 1) | |
| #define CPU_PDE_4M_PRESENT (1 << 0) | |
| /* | |
| * ページ・テーブル・エントリ (4k バイト・ページ) | |
| * | |
| * 31 12 11 9 8 7 6 5 4 3 2 1 0 | |
| * +----------------------------------------+------+-+-+-+-+---+---+---+---+-+ | |
| * | ページのベース・アドレス |使用可|G|0|D|A|PCD|PWT|U/S|R/W|P| | |
| * +----------------------------------------+------+-+-+-+-+---+---+---+---+-+ | |
| * | | | | | | | | | | | |
| * 9-11: システム・プログラマが使用可能 -------+ | | | | | | | | | | |
| * 8: グローバル・ページ -----------------------+ | | | | | | | | | |
| * 7: 予約 (0) -----------------------------------+ | | | | | | | | |
| * 6: ダーティ -------------------------------------+ | | | | | | | |
| * 5: アクセス ---------------------------------------+ | | | | | | |
| * 4: キャッシュ無効 ------------------------------------+ | | | | | |
| * 3: ライトスルー ------------------------------------------+ | | | | |
| * 2: ユーザ/スーパバイザ (0 = スーパバイザ) -------------------+ | | | |
| * 1: 読み取り/書き込み (0 = 読み取りのみ) -------------------------+ | | |
| * 0: ページ存在 -------------------------------------------------------+ | |
| */ | |
| #define CPU_PTE_BASEADDR_MASK 0xfffff000 | |
| #define CPU_PTE_GLOBAL_PAGE (1 << 8) | |
| #define CPU_PTE_DIRTY (1 << 6) | |
| #define CPU_PTE_ACCESS (1 << 5) | |
| #define CPU_PTE_CACHE_DISABLE (1 << 4) | |
| #define CPU_PTE_WRITE_THROUGH (1 << 3) | |
| #define CPU_PTE_USER_MODE (1 << 2) | |
| #define CPU_PTE_WRITABLE (1 << 1) | |
| #define CPU_PTE_PRESENT (1 << 0) | |
| /* enter/leave paging mode */ | /* enter/leave paging mode */ |
| void FASTCALL change_pg(int onoff); | void FASTCALL change_pg(int onoff); |
| Line 93 void MEMCALL cpu_linear_memory_write(DWO | Line 181 void MEMCALL cpu_linear_memory_write(DWO |
| cpu_linear_memory_read(a, 4, TRUE) : \ | cpu_linear_memory_read(a, 4, TRUE) : \ |
| cpu_memoryread_d(a); | cpu_memoryread_d(a); |
| #define set_CR3(cr3) \ | |
| do { \ | |
| CPU_CR3 = (cr3) & CPU_CR3_MASK; \ | |
| tlb_flush(FALSE); \ | |
| } while (/*CONSTCOND*/ 0) | |
| /* | /* |
| * TLB function | * TLB function |
| */ | */ |
| void tlb_init(); | void tlb_init(); |
| void tlb_flush(BOOL allflush); | void tlb_flush(BOOL allflush); |
| void tlb_flush_page(DWORD vaddr); | void tlb_flush_page(DWORD vaddr); |
| #ifdef __cplusplus | #ifdef __cplusplus |
| } | } |
| #endif | #endif |