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Diff for /np2/i386c/memory.c between versions 1.27 and 1.30

version 1.27, 2005/02/08 09:19:00 version 1.30, 2005/03/11 15:12:57
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 #ifndef NP2_MEMORY_ASM  #ifndef NP2_MEMORY_ASM
   
 #include        "cpucore.h"  #include        "cpucore.h"
 #include        "mem9821.h"  
 #include        "pccore.h"  #include        "pccore.h"
 #include        "iocore.h"  #include        "iocore.h"
   #include        "memtram.h"
   #include        "memvram.h"
 #include        "memegc.h"  #include        "memegc.h"
   #if defined(SUPPORT_PC9821)
   #include        "memvga.h"
   #endif
   #include        "memems.h"
   #include        "memepp.h"
 #include        "vram.h"  #include        "vram.h"
 #include        "font.h"  #include        "font.h"
   
   
         BYTE    mem[0x200000];          UINT8   mem[0x200000];
   
   
 // ---- write byte  
   
 static void MEMCALL i286_wt(UINT32 address, REG8 value) {               // MAIN  
   
         mem[address & CPU_ADRSMASK] = (BYTE)value;  
 }  
   
 static void MEMCALL tram_wt(UINT32 address, REG8 value) {               // TRAM  
   
         CPU_REMCLOCK -= MEMWAIT_TRAM;  
         if (address < 0xa2000) {  
                 mem[address] = (BYTE)value;  
                 tramupdate[LOW12(address >> 1)] = 1;  
                 gdcs.textdisp |= 1;  
         }  
         else if (address < 0xa3fe0) {  
                 if (!(address & 1)) {  
                         mem[address] = (BYTE)value;  
                         tramupdate[LOW12(address >> 1)] = 1;  
                         gdcs.textdisp |= 1;  
                 }  
         }  
         else if (address < 0xa4000) {  
                 if (!(address & 1)) {  
                         if ((!(address & 2)) || (gdcs.msw_accessable)) {  
                                 mem[address] = (BYTE)value;  
                                 tramupdate[LOW12(address >> 1)] = 1;  
                                 gdcs.textdisp |= 1;  
                         }  
                 }  
         }  
         else if (address < 0xa5000) {  
                 if ((address & 1) && (cgwindow.writable & 1)) {  
                         cgwindow.writable |= 0x80;  
                         fontrom[cgwindow.high + ((address >> 1) & 0x0f)] = (BYTE)value;  
                 }  
         }  
 }  
   
 static void MEMCALL vram_w0(UINT32 address, REG8 value) {               // VRAM  
   
         CPU_REMCLOCK -= MEMWAIT_VRAM;  
         mem[address] = (BYTE)value;  
         vramupdate[LOW15(address)] |= 1;  
         gdcs.grphdisp |= 1;  
 }  
   
 static void MEMCALL vram_w1(UINT32 address, REG8 value) {               // VRAM  
   
         CPU_REMCLOCK -= MEMWAIT_VRAM;  
         mem[address + VRAM_STEP] = (BYTE)value;  
         vramupdate[LOW15(address)] |= 2;  
         gdcs.grphdisp |= 2;  
 }  
   
 static void MEMCALL grcg_rmw0(UINT32 address, REG8 value) {             // VRAM  
   
         REG8    mask;  
         BYTE    *vram;  
   
         CPU_REMCLOCK -= MEMWAIT_GRCG;  
         mask = ~value;  
         address = LOW15(address);  
         vramupdate[address] |= 1;  
         gdcs.grphdisp |= 1;  
         vram = mem + address;  
         if (!(grcg.modereg & 1)) {  
                 vram[VRAM0_B] &= mask;  
                 vram[VRAM0_B] |= (value & grcg.tile[0].b[0]);  
         }  
         if (!(grcg.modereg & 2)) {  
                 vram[VRAM0_R] &= mask;  
                 vram[VRAM0_R] |= (value & grcg.tile[1].b[0]);  
         }  
         if (!(grcg.modereg & 4)) {  
                 vram[VRAM0_G] &= mask;  
                 vram[VRAM0_G] |= (value & grcg.tile[2].b[0]);  
         }  
         if (!(grcg.modereg & 8)) {  
                 vram[VRAM0_E] &= mask;  
                 vram[VRAM0_E] |= (value & grcg.tile[3].b[0]);  
         }  
 }  
   
 static void MEMCALL grcg_rmw1(UINT32 address, REG8 value) {             // VRAM  
   
         REG8    mask;  
         BYTE    *vram;  
   
         CPU_REMCLOCK -= MEMWAIT_GRCG;  
         mask = ~value;  
         address = LOW15(address);  
         vramupdate[address] |= 2;  
         gdcs.grphdisp |= 2;  
         vram = mem + address;  
         if (!(grcg.modereg & 1)) {  
                 vram[VRAM1_B] &= mask;  
                 vram[VRAM1_B] |= (value & grcg.tile[0].b[0]);  
         }  
         if (!(grcg.modereg & 2)) {  
                 vram[VRAM1_R] &= mask;  
                 vram[VRAM1_R] |= (value & grcg.tile[1].b[0]);  
         }  
         if (!(grcg.modereg & 4)) {  
                 vram[VRAM1_G] &= mask;  
                 vram[VRAM1_G] |= (value & grcg.tile[2].b[0]);  
         }  
         if (!(grcg.modereg & 8)) {  
                 vram[VRAM1_E] &= mask;  
                 vram[VRAM1_E] |= (value & grcg.tile[3].b[0]);  
         }  
 }  
   
 static void MEMCALL grcg_tdw0(UINT32 address, REG8 value) {             // VRAM  
   
         BYTE    *vram;  
   
         CPU_REMCLOCK -= MEMWAIT_GRCG;  
         address = LOW15(address);  
         vramupdate[address] |= 1;  
         gdcs.grphdisp |= 1;  
         vram = mem + address;  
         if (!(grcg.modereg & 1)) {  
                 vram[VRAM0_B] = grcg.tile[0].b[0];  
         }  
         if (!(grcg.modereg & 2)) {  
                 vram[VRAM0_R] = grcg.tile[1].b[0];  
         }  
         if (!(grcg.modereg & 4)) {  
                 vram[VRAM0_G] = grcg.tile[2].b[0];  
         }  
         if (!(grcg.modereg & 8)) {  
                 vram[VRAM0_E] = grcg.tile[3].b[0];  
         }  
         (void)value;  
 }  
   
 static void MEMCALL grcg_tdw1(UINT32 address, REG8 value) {             // VRAM  
   
         BYTE    *vram;  
   
         CPU_REMCLOCK -= MEMWAIT_GRCG;  
         address = LOW15(address);  
         vramupdate[address] |= 2;  
         gdcs.grphdisp |= 2;  
         vram = mem + address;  
         if (!(grcg.modereg & 1)) {  
                 vram[VRAM1_B] = grcg.tile[0].b[0];  
         }  
         if (!(grcg.modereg & 2)) {  
                 vram[VRAM1_R] = grcg.tile[1].b[0];  
         }  
         if (!(grcg.modereg & 4)) {  
                 vram[VRAM1_G] = grcg.tile[2].b[0];  
         }  
         if (!(grcg.modereg & 8)) {  
                 vram[VRAM1_E] = grcg.tile[3].b[0];  
         }  
         (void)value;  
 }  
   
 static void MEMCALL egc_wt(UINT32 address, REG8 value) {                // VRAM  
   
         CPU_REMCLOCK -= MEMWAIT_GRCG;  
         memegc_wr8(address, value);  
 }  
   
 static void MEMCALL emmc_wt(UINT32 address, REG8 value) {               // EMS  
   
         CPU_EMSPTR[(address >> 14) & 3][LOW14(address)] = (BYTE)value;  
 }  
   
 static void MEMCALL i286_wd(UINT32 address, REG8 value) {               // D000¡ÁDFFF  // ---- MAIN
   
         if (CPU_RAM_D000 & (1 << ((address >> 12) & 15))) {  static REG8 MEMCALL memmain_rd8(UINT32 address) {
                 mem[address] = (BYTE)value;  
         }  
 }  
   
 static void MEMCALL i286_wb(UINT32 address, REG8 value) {               // F800¡ÁFFFF  
   
         mem[address + 0x1c8000 - 0xe8000] = (BYTE)value;  
 }  
   
 static void MEMCALL i286_wn(UINT32 address, REG8 value) {               // NONE  
   
         (void)address;  
         (void)value;  
 }  
   
   
 // ---- read byte  
   
 static REG8 MEMCALL i286_rd(UINT32 address) {                                   // MAIN  
   
         return(mem[address & CPU_ADRSMASK]);          return(mem[address & CPU_ADRSMASK]);
 }  }
   
 static REG8 MEMCALL tram_rd(UINT32 address) {                                   // TRAM  static REG16 MEMCALL memmain_rd16(UINT32 address) {
   
         CPU_REMCLOCK -= MEMWAIT_TRAM;  
         if (address < 0xa4000) {  
                 return(mem[address]);  
         }  
         else if (address < 0xa5000) {  
                 if (address & 1) {  
                         return(fontrom[cgwindow.high + ((address >> 1) & 0x0f)]);  
                 }  
                 else {  
                         return(fontrom[cgwindow.low + ((address >> 1) & 0x0f)]);  
                 }  
         }  
         return(mem[address]);  
 }  
   
 static REG8 MEMCALL vram_r0(UINT32 address) {                                   // VRAM  
   
         CPU_REMCLOCK -= MEMWAIT_VRAM;  
         return(mem[address]);  
 }  
   
 static REG8 MEMCALL vram_r1(UINT32 address) {                                   // VRAM  
   
         CPU_REMCLOCK -= MEMWAIT_VRAM;  
         return(mem[address + VRAM_STEP]);  
 }  
   
 static REG8 MEMCALL grcg_tcr0(UINT32 address) {                                 // VRAM  
   
 const BYTE      *vram;  
         REG8    ret;  
   
         CPU_REMCLOCK -= MEMWAIT_GRCG;  
         vram = mem + LOW15(address);  
         ret = 0;  
         if (!(grcg.modereg & 1)) {  
                 ret |= vram[VRAM0_B] ^ grcg.tile[0].b[0];  
         }  
         if (!(grcg.modereg & 2)) {  
                 ret |= vram[VRAM0_R] ^ grcg.tile[1].b[0];  
         }  
         if (!(grcg.modereg & 4)) {  
                 ret |= vram[VRAM0_G] ^ grcg.tile[2].b[0];  
         }  
         if (!(grcg.modereg & 8)) {  
                 ret |= vram[VRAM0_E] ^ grcg.tile[3].b[0];  
         }  
         return(ret ^ 0xff);  
 }  
   
 static REG8 MEMCALL grcg_tcr1(UINT32 address) {                                 // VRAM  
   
 const BYTE      *vram;  
         REG8    ret;  
   
         CPU_REMCLOCK -= MEMWAIT_GRCG;  
         ret = 0;  
         vram = mem + LOW15(address);  
         if (!(grcg.modereg & 1)) {  
                 ret |= vram[VRAM1_B] ^ grcg.tile[0].b[0];  
         }  
         if (!(grcg.modereg & 2)) {  
                 ret |= vram[VRAM1_R] ^ grcg.tile[1].b[0];  
         }  
         if (!(grcg.modereg & 4)) {  
                 ret |= vram[VRAM1_G] ^ grcg.tile[2].b[0];  
         }  
         if (!(grcg.modereg & 8)) {  
                 ret |= vram[VRAM1_E] ^ grcg.tile[3].b[0];  
         }  
         return(ret ^ 0xff);  
 }  
   
 static REG8 MEMCALL egc_rd(UINT32 address) {                                    // VRAM  
   
         CPU_REMCLOCK -= MEMWAIT_GRCG;  
         return(memegc_rd8(address));  
 }  
   
 static REG8 MEMCALL emmc_rd(UINT32 address) {                                   // EMS  const UINT8     *ptr;
   
         return(CPU_EMSPTR[(address >> 14) & 3][LOW14(address)]);          ptr = mem + (address & CPU_ADRSMASK);
           return(LOADINTELWORD(ptr));
 }  }
   
 static REG8 MEMCALL i286_rb(UINT32 address) {                                   // F800-FFFF  static void MEMCALL memmain_wr8(UINT32 address, REG8 value) {
   
         if (CPU_ITFBANK) {          mem[address & CPU_ADRSMASK] = (UINT8)value;
                 address += VRAM_STEP;  
         }  
         return(mem[address]);  
 }  }
   
   static void MEMCALL memmain_wr16(UINT32 address, REG16 value) {
   
 // ---- write word          UINT8   *ptr;
   
 static void MEMCALL i286w_wt(UINT32 address, REG16 value) {  
   
         BYTE    *ptr;  
   
         ptr = mem + (address & CPU_ADRSMASK);          ptr = mem + (address & CPU_ADRSMASK);
         STOREINTELWORD(ptr, value);          STOREINTELWORD(ptr, value);
 }  }
   
 static void MEMCALL tramw_wt(UINT32 address, REG16 value) {  
   
         CPU_REMCLOCK -= MEMWAIT_TRAM;  // ---- N/C
         if (address < 0xa1fff) {  
                 STOREINTELWORD(mem + address, value);  
                 tramupdate[LOW12(address >> 1)] = 1;  
                 tramupdate[LOW12((address + 1) >> 1)] = 1;  
                 gdcs.textdisp |= 1;  
         }  
         else if (address == 0xa1fff) {  
                 STOREINTELWORD(mem + address, value);  
                 tramupdate[0] = 1;  
                 tramupdate[0xfff] = 1;  
                 gdcs.textdisp |= 1;  
         }  
         else if (address < 0xa3fe0) {  
                 if (address & 1) {  
                         address++;  
                         value >>= 8;  
                 }  
                 mem[address] = (BYTE)value;  
                 tramupdate[LOW12(address >> 1)] = 1;  
                 gdcs.textdisp |= 1;  
         }  
         else if (address < 0xa3fff) {  
                 if (address & 1) {  
                         address++;  
                         value >>= 8;  
                 }  
                 if ((!(address & 2)) || (gdcs.msw_accessable)) {  
                         mem[address] = (BYTE)value;  
                         tramupdate[LOW12(address >> 1)] = 1;  
                         gdcs.textdisp |= 1;  
                 }  
         }  
         else if (address < 0xa5000) {  
                 if (!(address & 1)) {  
                         value >>= 8;  
                 }  
                 if (cgwindow.writable & 1) {  
                         cgwindow.writable |= 0x80;  
                         fontrom[cgwindow.high + ((address >> 1) & 0x0f)] = (BYTE)value;  
                 }  
         }  
 }  
   
   static REG8 MEMCALL memnc_rd8(UINT32 address) {
   
 #define GRCGW_NON(page) {                                                                                       \          (void)address;
         CPU_REMCLOCK -= MEMWAIT_VRAM;                                                                   \          return(0xff);
         STOREINTELWORD(mem + address + VRAM_STEP*(page), value);                \  
         vramupdate[LOW15(address)] |= (1 << page);                                              \  
         vramupdate[LOW15(address + 1)] |= (1 << page);                                  \  
         gdcs.grphdisp |= (1 << page);                                                                   \  
 }  
   
 #define GRCGW_RMW(page) {                                                                                       \  
         BYTE    *vram;                                                                                                  \  
         CPU_REMCLOCK -= MEMWAIT_GRCG;                                                                   \  
         address = LOW15(address);                                                                               \  
         vramupdate[address] |= (1 << page);                                                             \  
         vramupdate[address + 1] |= (1 << page);                                                 \  
         gdcs.grphdisp |= (1 << page);                                                                   \  
         vram = mem + address + (VRAM_STEP * (page));                                    \  
         if (!(grcg.modereg & 1)) {                                                                              \  
                 BYTE tmp;                                                                                                       \  
                 tmp = (BYTE)value;                                                                                      \  
                 vram[VRAM0_B+0] &= (~tmp);                                                                      \  
                 vram[VRAM0_B+0] |= (tmp & grcg.tile[0].b[0]);                           \  
                 tmp = (BYTE)(value >> 8);                                                                       \  
                 vram[VRAM0_B+1] &= (~tmp);                                                                      \  
                 vram[VRAM0_B+1] |= (tmp & grcg.tile[0].b[0]);                           \  
         }                                                                                                                               \  
         if (!(grcg.modereg & 2)) {                                                                              \  
                 BYTE tmp;                                                                                                       \  
                 tmp = (BYTE)value;                                                                                      \  
                 vram[VRAM0_R+0] &= (~tmp);                                                                      \  
                 vram[VRAM0_R+0] |= (tmp & grcg.tile[1].b[0]);                           \  
                 tmp = (BYTE)(value >> 8);                                                                       \  
                 vram[VRAM0_R+1] &= (~tmp);                                                                      \  
                 vram[VRAM0_R+1] |= (tmp & grcg.tile[1].b[0]);                           \  
         }                                                                                                                               \  
         if (!(grcg.modereg & 4)) {                                                                              \  
                 BYTE tmp;                                                                                                       \  
                 tmp = (BYTE)value;                                                                                      \  
                 vram[VRAM0_G+0] &= (~tmp);                                                                      \  
                 vram[VRAM0_G+0] |= (tmp & grcg.tile[2].b[0]);                           \  
                 tmp = (BYTE)(value >> 8);                                                                       \  
                 vram[VRAM0_G+1] &= (~tmp);                                                                      \  
                 vram[VRAM0_G+1] |= (tmp & grcg.tile[2].b[0]);                           \  
         }                                                                                                                               \  
         if (!(grcg.modereg & 8)) {                                                                              \  
                 BYTE tmp;                                                                                                       \  
                 tmp = (BYTE)value;                                                                                      \  
                 vram[VRAM0_E+0] &= (~tmp);                                                                      \  
                 vram[VRAM0_E+0] |= (tmp & grcg.tile[3].b[0]);                           \  
                 tmp = (BYTE)(value >> 8);                                                                       \  
                 vram[VRAM0_E+1] &= (~tmp);                                                                      \  
                 vram[VRAM0_E+1] |= (tmp & grcg.tile[3].b[0]);                           \  
         }                                                                                                                               \  
 }  
   
 #define GRCGW_TDW(page) {                                                                                       \  
         BYTE    *vram;                                                                                                  \  
         CPU_REMCLOCK -= MEMWAIT_GRCG;                                                                   \  
         address = LOW15(address);                                                                               \  
         vramupdate[address] |= (1 << page);                                                             \  
         vramupdate[address + 1] |= (1 << page);                                                 \  
         gdcs.grphdisp |= (1 << page);                                                                   \  
         vram = mem + address + (VRAM_STEP * (page));                                    \  
         if (!(grcg.modereg & 1)) {                                                                              \  
                 vram[VRAM0_B+0] = grcg.tile[0].b[0];                                            \  
                 vram[VRAM0_B+1] = grcg.tile[0].b[0];                                            \  
         }                                                                                                                               \  
         if (!(grcg.modereg & 2)) {                                                                              \  
                 vram[VRAM0_R+0] = grcg.tile[1].b[0];                                            \  
                 vram[VRAM0_R+1] = grcg.tile[1].b[0];                                            \  
         }                                                                                                                               \  
         if (!(grcg.modereg & 4)) {                                                                              \  
                 vram[VRAM0_G+0] = grcg.tile[2].b[0];                                            \  
                 vram[VRAM0_G+1] = grcg.tile[2].b[0];                                            \  
         }                                                                                                                               \  
         if (!(grcg.modereg & 8)) {                                                                              \  
                 vram[VRAM0_E+0] = grcg.tile[3].b[0];                                            \  
                 vram[VRAM0_E+1] = grcg.tile[3].b[0];                                            \  
         }                                                                                                                               \  
         (void)value;                                                                                                    \  
 }  
   
 static void MEMCALL vramw_w0(UINT32 address, REG16 value) GRCGW_NON(0)  
 static void MEMCALL vramw_w1(UINT32 address, REG16 value) GRCGW_NON(1)  
 static void MEMCALL grcgw_rmw0(UINT32 address, REG16 value) GRCGW_RMW(0)  
 static void MEMCALL grcgw_rmw1(UINT32 address, REG16 value) GRCGW_RMW(1)  
 static void MEMCALL grcgw_tdw0(UINT32 address, REG16 value) GRCGW_TDW(0)  
 static void MEMCALL grcgw_tdw1(UINT32 address, REG16 value) GRCGW_TDW(1)  
   
 static void MEMCALL egcw_wt(UINT32 address, REG16 value) {  
   
         CPU_REMCLOCK -= MEMWAIT_GRCG;  
         memegc_wr16(address, value);  
 }  
   
 static void MEMCALL emmcw_wt(UINT32 address, REG16 value) {  
   
         BYTE    *ptr;  
   
         if ((address & 0x3fff) != 0x3fff) {  
                 ptr = CPU_EMSPTR[(address >> 14) & 3] + LOW14(address);  
                 STOREINTELWORD(ptr, value);  
         }  
         else {  
                 CPU_EMSPTR[(address >> 14) & 3][0x3fff] = (BYTE)value;  
                 CPU_EMSPTR[((address + 1) >> 14) & 3][0] = (BYTE)(value >> 8);  
         }  
 }  
   
 static void MEMCALL i286w_wd(UINT32 address, REG16 value) {  
   
         BYTE    *ptr;  
         UINT16  bit;  
   
         ptr = mem + address;  
         bit = 1 << ((address >> 12) & 15);  
         if ((address + 1) & 0xfff) {  
                 if (CPU_RAM_D000 & bit) {  
                         STOREINTELWORD(ptr, value);  
                 }  
         }  
         else {  
                 if (CPU_RAM_D000 & bit) {  
                         ptr[0] = (UINT8)value;  
                 }  
                 if (CPU_RAM_D000 & (bit << 1)) {  
                         ptr[1] = (UINT8)(value >> 8);  
                 }  
         }  
 }  }
   
 static void MEMCALL i286w_wb(UINT32 address, REG16 value) {  static REG16 MEMCALL memnc_rd16(UINT32 address) {
   
         BYTE    *ptr;  
   
         ptr = mem + (address + 0x1c8000 - 0xe8000);          (void)address;
         STOREINTELWORD(ptr, value);          return(0xffff);
 }  }
   
 static void MEMCALL i286w_wn(UINT32 address, REG16 value) {  static void MEMCALL memnc_wr8(UINT32 address, REG8 value) {
   
         (void)address;          (void)address;
         (void)value;          (void)value;
 }  }
   
   static void MEMCALL memnc_wr16(UINT32 address, REG16 value) {
   
 // ---- read word          (void)address;
           (void)value;
 static REG16 MEMCALL i286w_rd(UINT32 address) {  
   
         BYTE    *ptr;  
   
         ptr = mem + (address & CPU_ADRSMASK);  
         return(LOADINTELWORD(ptr));  
 }  
   
 static REG16 MEMCALL tramw_rd(UINT32 address) {  
   
         CPU_REMCLOCK -= MEMWAIT_TRAM;  
         if (address < (0xa4000 - 1)) {  
                 return(LOADINTELWORD(mem + address));  
         }  
         else if (address == 0xa3fff) {  
                 return(mem[address] + (fontrom[cgwindow.low] << 8));  
         }  
         else if (address < 0xa4fff) {  
                 if (address & 1) {  
                         REG16 ret;  
                         ret = fontrom[cgwindow.high + ((address >> 1) & 0x0f)];  
                         ret += fontrom[cgwindow.low + (((address + 1) >> 1) & 0x0f)] << 8;  
                         return(ret);  
                 }  
                 else {  
                         REG16 ret;  
                         ret = fontrom[cgwindow.low + ((address >> 1) & 0x0f)];  
                         ret += fontrom[cgwindow.high + ((address >> 1) & 0x0f)] << 8;  
                         return(ret);  
                 }  
         }  
         else if (address == 0xa4fff) {  
                 return((mem[0xa5000] << 8) | fontrom[cgwindow.high + 15]);  
         }  
         return(LOADINTELWORD(mem + address));  
 }  
   
 static REG16 MEMCALL vramw_r0(UINT32 address) {  
   
         CPU_REMCLOCK -= MEMWAIT_VRAM;  
         return(LOADINTELWORD(mem + address));  
 }  
   
 static REG16 MEMCALL vramw_r1(UINT32 address) {  
   
         CPU_REMCLOCK -= MEMWAIT_VRAM;  
         return(LOADINTELWORD(mem + address + VRAM_STEP));  
 }  
   
 static REG16 MEMCALL grcgw_tcr0(UINT32 address) {  
   
         BYTE    *vram;  
         REG16   ret;  
   
         CPU_REMCLOCK -= MEMWAIT_GRCG;  
         ret = 0;  
         vram = mem + LOW15(address);  
         if (!(grcg.modereg & 1)) {  
                 ret |= LOADINTELWORD(vram + VRAM0_B) ^ grcg.tile[0].w;  
         }  
         if (!(grcg.modereg & 2)) {  
                 ret |= LOADINTELWORD(vram + VRAM0_R) ^ grcg.tile[1].w;  
         }  
         if (!(grcg.modereg & 4)) {  
                 ret |= LOADINTELWORD(vram + VRAM0_G) ^ grcg.tile[2].w;  
         }  
         if (!(grcg.modereg & 8)) {  
                 ret |= LOADINTELWORD(vram + VRAM0_E) ^ grcg.tile[3].w;  
         }  
         return((UINT16)~ret);  
 }  
   
 static REG16 MEMCALL grcgw_tcr1(UINT32 address) {  
   
         BYTE    *vram;  
         REG16   ret;  
   
         CPU_REMCLOCK -= MEMWAIT_GRCG;  
         ret = 0;  
         vram = mem + LOW15(address);  
         if (!(grcg.modereg & 1)) {  
                 ret |= LOADINTELWORD(vram + VRAM1_B) ^ grcg.tile[0].w;  
         }  
         if (!(grcg.modereg & 2)) {  
                 ret |= LOADINTELWORD(vram + VRAM1_R) ^ grcg.tile[1].w;  
         }  
         if (!(grcg.modereg & 4)) {  
                 ret |= LOADINTELWORD(vram + VRAM1_G) ^ grcg.tile[2].w;  
         }  
         if (!(grcg.modereg & 8)) {  
                 ret |= LOADINTELWORD(vram + VRAM1_E) ^ grcg.tile[3].w;  
         }  
         return((UINT16)(~ret));  
 }  
   
 static REG16 MEMCALL egcw_rd(UINT32 address) {  
   
         CPU_REMCLOCK -= MEMWAIT_GRCG;  
         return(memegc_rd16(address));  
 }  
   
 static REG16 MEMCALL emmcw_rd(UINT32 address) {  
   
 const BYTE      *ptr;  
         REG16   ret;  
   
         if ((address & 0x3fff) != 0x3fff) {  
                 ptr = CPU_EMSPTR[(address >> 14) & 3] + LOW14(address);  
                 return(LOADINTELWORD(ptr));  
         }  
         else {  
                 ret = CPU_EMSPTR[(address >> 14) & 3][0x3fff];  
                 ret += CPU_EMSPTR[((address + 1) >> 14) & 3][0] << 8;  
                 return(ret);  
         }  
 }  
   
 static REG16 MEMCALL i286w_rb(UINT32 address) {  
   
         if (CPU_ITFBANK) {  
                 address += VRAM_STEP;  
         }  
         return(LOADINTELWORD(mem + address));  
 }  }
   
   
Line 668  typedef struct { Line 107  typedef struct {
 } VACCTBL;  } VACCTBL;
   
 static MEMFN memfn = {  static MEMFN memfn = {
                    {i286_rd,    i286_rd,        i286_rd,        i286_rd,                // 00             {memmain_rd8,        memmain_rd8,    memmain_rd8,    memmain_rd8,    // 00
                         i286_rd,        i286_rd,        i286_rd,        i286_rd,                // 20                  memmain_rd8,    memmain_rd8,    memmain_rd8,    memmain_rd8,    // 20
                         i286_rd,        i286_rd,        i286_rd,        i286_rd,                // 40                  memmain_rd8,    memmain_rd8,    memmain_rd8,    memmain_rd8,    // 40
                         i286_rd,        i286_rd,        i286_rd,        i286_rd,                // 60                  memmain_rd8,    memmain_rd8,    memmain_rd8,    memmain_rd8,    // 60
                         i286_rd,        i286_rd,        i286_rd,        i286_rd,                // 80                  memmain_rd8,    memmain_rd8,    memmain_rd8,    memmain_rd8,    // 80
                         tram_rd,        vram_r0,        vram_r0,        vram_r0,                // a0                  memtram_rd8,    memvram0_rd8,   memvram0_rd8,   memvram0_rd8,   // a0
                         emmc_rd,        emmc_rd,        i286_rd,        i286_rd,                // c0                  memems_rd8,             memems_rd8,             memmain_rd8,    memmain_rd8,    // c0
                         vram_r0,        i286_rd,        i286_rd,        i286_rb},               // e0                  memvram0_rd8,   memmain_rd8,    memmain_rd8,    memf800_rd8},   // e0
   
                    {i286_wt,    i286_wt,        i286_wt,        i286_wt,                // 00             {memmain_wr8,        memmain_wr8,    memmain_wr8,    memmain_wr8,    // 00
                         i286_wt,        i286_wt,        i286_wt,        i286_wt,                // 20                  memmain_wr8,    memmain_wr8,    memmain_wr8,    memmain_wr8,    // 20
                         i286_wt,        i286_wt,        i286_wt,        i286_wt,                // 40                  memmain_wr8,    memmain_wr8,    memmain_wr8,    memmain_wr8,    // 40
                         i286_wt,        i286_wt,        i286_wt,        i286_wt,                // 60                  memmain_wr8,    memmain_wr8,    memmain_wr8,    memmain_wr8,    // 60
                         i286_wt,        i286_wt,        i286_wt,        i286_wt,                // 80                  memmain_wr8,    memmain_wr8,    memmain_wr8,    memmain_wr8,    // 80
                         tram_wt,        vram_w0,        vram_w0,        vram_w0,                // a0                  memtram_wr8,    memvram0_wr8,   memvram0_wr8,   memvram0_wr8,   // a0
                         emmc_wt,        emmc_wt,        i286_wd,        i286_wd,                // c0                  memems_wr8,             memems_wr8,             memd000_wr8,    memd000_wr8,    // c0
                         vram_w0,        i286_wn,        i286_wn,        i286_wn},               // e0                  memvram0_wr8,   memnc_wr8,              memnc_wr8,              memnc_wr8},             // e0
   
                    {i286w_rd,   i286w_rd,       i286w_rd,       i286w_rd,               // 00             {memmain_rd16,       memmain_rd16,   memmain_rd16,   memmain_rd16,   // 00
                         i286w_rd,       i286w_rd,       i286w_rd,       i286w_rd,               // 20                  memmain_rd16,   memmain_rd16,   memmain_rd16,   memmain_rd16,   // 20
                         i286w_rd,       i286w_rd,       i286w_rd,       i286w_rd,               // 40                  memmain_rd16,   memmain_rd16,   memmain_rd16,   memmain_rd16,   // 40
                         i286w_rd,       i286w_rd,       i286w_rd,       i286w_rd,               // 60                  memmain_rd16,   memmain_rd16,   memmain_rd16,   memmain_rd16,   // 60
                         i286w_rd,       i286w_rd,       i286w_rd,       i286w_rd,               // 80                  memmain_rd16,   memmain_rd16,   memmain_rd16,   memmain_rd16,   // 80
                         tramw_rd,       vramw_r0,       vramw_r0,       vramw_r0,               // a0                  memtram_rd16,   memvram0_rd16,  memvram0_rd16,  memvram0_rd16,  // a0
                         emmcw_rd,       emmcw_rd,       i286w_rd,       i286w_rd,               // c0                  memems_rd16,    memems_rd16,    memmain_rd16,   memmain_rd16,   // c0
                         vramw_r0,       i286w_rd,       i286w_rd,       i286w_rb},              // e0                  memvram0_rd16,  memmain_rd16,   memmain_rd16,   memf800_rd16},  // e0
   
                    {i286w_wt,   i286w_wt,       i286w_wt,       i286w_wt,               // 00             {memmain_wr16,       memmain_wr16,   memmain_wr16,   memmain_wr16,   // 00
                         i286w_wt,       i286w_wt,       i286w_wt,       i286w_wt,               // 20                  memmain_wr16,   memmain_wr16,   memmain_wr16,   memmain_wr16,   // 20
                         i286w_wt,       i286w_wt,       i286w_wt,       i286w_wt,               // 40                  memmain_wr16,   memmain_wr16,   memmain_wr16,   memmain_wr16,   // 40
                         i286w_wt,       i286w_wt,       i286w_wt,       i286w_wt,               // 60                  memmain_wr16,   memmain_wr16,   memmain_wr16,   memmain_wr16,   // 60
                         i286w_wt,       i286w_wt,       i286w_wt,       i286w_wt,               // 80                  memmain_wr16,   memmain_wr16,   memmain_wr16,   memmain_wr16,   // 80
                         tramw_wt,       vramw_w0,       vramw_w0,       vramw_w0,               // a0                  memtram_wr16,   memvram0_wr16,  memvram0_wr16,  memvram0_wr16,  // a0
                         emmcw_wt,       emmcw_wt,       i286w_wd,       i286w_wd,               // c0                  memems_wr16,    memems_wr16,    memd000_wr16,   memd000_wr16,   // c0
                         vramw_w0,       i286w_wn,       i286w_wn,       i286w_wn}};             // e0                  memvram0_wr16,  memnc_wr16,             memnc_wr16,             memnc_wr16}};   // e0
   
 static const MMAPTBL mmaptbl[2] = {  static const MMAPTBL mmaptbl[2] = {
                    {i286_rd,    i286_rb,        i286_wn,                     {memmain_rd8,        memf800_rd8,    memnc_wr8,
                         i286w_rd,       i286w_rb,       i286w_wn},                          memmain_rd16,   memf800_rd16,   memnc_wr16},
                    {i286_rb,    i286_rb,        i286_wb,                     {memf800_rd8,        memf800_rd8,    memepson_wr8,
                         i286w_rb,       i286w_rb,       i286w_wb}};                          memf800_rd16,   memf800_rd16,   memepson_wr16}};
   
 static const VACCTBL vacctbl[0x10] = {  static const VACCTBL vacctbl[0x10] = {
                         {vram_r0,       vram_w0,        vramw_r0,       vramw_w0},              // 00                  {memvram0_rd8,  memvram0_wr8,   memvram0_rd16,  memvram0_wr16}, // 00
                         {vram_r1,       vram_w1,        vramw_r1,       vramw_w1},                  {memvram1_rd8,  memvram1_wr8,   memvram1_rd16,  memvram1_wr16},
                         {vram_r0,       vram_w0,        vramw_r0,       vramw_w0},                  {memvram0_rd8,  memvram0_wr8,   memvram0_rd16,  memvram0_wr16},
                         {vram_r1,       vram_w1,        vramw_r1,       vramw_w1},                  {memvram1_rd8,  memvram1_wr8,   memvram1_rd16,  memvram1_wr16},
                         {vram_r0,       vram_w0,        vramw_r0,       vramw_w0},              // 40                  {memvram0_rd8,  memvram0_wr8,   memvram0_rd16,  memvram0_wr16}, // 40
                         {vram_r1,       vram_w1,        vramw_r1,       vramw_w1},                  {memvram1_rd8,  memvram1_wr8,   memvram1_rd16,  memvram1_wr16},
                         {vram_r0,       vram_w0,        vramw_r0,       vramw_w0},                  {memvram0_rd8,  memvram0_wr8,   memvram0_rd16,  memvram0_wr16},
                         {vram_r1,       vram_w1,        vramw_r1,       vramw_w1},                  {memvram1_rd8,  memvram1_wr8,   memvram1_rd16,  memvram1_wr16},
                         {grcg_tcr0,     grcg_tdw0,      grcgw_tcr0,     grcgw_tdw0},    // 80 tdw/tcr                  {memtcr0_rd8,   memtdw0_wr8,    memtcr0_rd16,   memtdw0_wr16},  // 80
                         {grcg_tcr1,     grcg_tdw1,      grcgw_tcr1,     grcgw_tdw1},                  {memtcr1_rd8,   memtdw1_wr8,    memtcr1_rd16,   memtdw1_wr16},
                         {egc_rd,        egc_wt,         egcw_rd,        egcw_wt},                  {memegc_rd8,    memegc_wr8,             memegc_rd16,    memegc_wr16},
                         {egc_rd,        egc_wt,         egcw_rd,        egcw_wt},                  {memegc_rd8,    memegc_wr8,             memegc_rd16,    memegc_wr16},
                         {vram_r0,       grcg_rmw0,      vramw_r0,       grcgw_rmw0},    // c0 rmw                  {memvram0_rd8,  memrmw0_wr8,    memvram0_rd16,  memrmw0_wr16},  // c0
                         {vram_r1,       grcg_rmw1,      vramw_r1,       grcgw_rmw1},                  {memvram1_rd8,  memrmw1_wr8,    memvram1_rd16,  memrmw1_wr16},
                         {egc_rd,        egc_wt,         egcw_rd,        egcw_wt},                  {memegc_rd8,    memegc_wr8,             memegc_rd16,    memegc_wr16},
                         {egc_rd,        egc_wt,         egcw_rd,        egcw_wt}};                  {memegc_rd8,    memegc_wr8,             memegc_rd16,    memegc_wr16}};
   
   
 static REG8 MEMCALL i286_nonram_r(UINT32 address) {  
   
         (void)address;  
         return(0xff);  
 }  
   
 static REG16 MEMCALL i286_nonram_rw(UINT32 address) {  
   
         (void)address;  
         return(0xffff);  
 }  
   
   
 void MEMCALL i286_memorymap(UINT type) {  void MEMCALL i286_memorymap(UINT type) {
Line 792  const VACCTBL *vacc; Line 218  const VACCTBL *vacc;
                 memfn.wr16[0xe0000 >> 15] = vacc->wr16;                  memfn.wr16[0xe0000 >> 15] = vacc->wr16;
   
                 if (!(func & 0x10)) {                                                   // digital                  if (!(func & 0x10)) {                                                   // digital
                         memfn.wr8[0xe0000 >> 15] = i286_wn;                          memfn.rd8[0xe0000 >> 15] = memnc_rd8;
                         memfn.wr16[0xe0000 >> 15] = i286w_wn;                          memfn.wr8[0xe0000 >> 15] = memnc_wr8;
                         memfn.rd8[0xe0000 >> 15] = i286_nonram_r;                          memfn.rd16[0xe0000 >> 15] = memnc_rd16;
                         memfn.rd16[0xe0000 >> 15] = i286_nonram_rw;                          memfn.wr16[0xe0000 >> 15] = memnc_wr16;
                 }                  }
 #if defined(SUPPORT_PC9821)  #if defined(SUPPORT_PC9821)
         }          }
         else {          else {
                 memfn.rd8[0xa8000 >> 15] = mem9821_b0r;                  memfn.rd8[0xa8000 >> 15] = memvga0_rd8;
                 memfn.rd8[0xb0000 >> 15] = mem9821_b0r;                  memfn.rd8[0xb0000 >> 15] = memvga0_rd8;
                 memfn.rd8[0xb8000 >> 15] = i286_nonram_r;                  memfn.rd8[0xb8000 >> 15] = memnc_rd8;
                 memfn.rd8[0xe0000 >> 15] = mem9821_b2r;                  memfn.rd8[0xe0000 >> 15] = memvgaio_rd8;
   
                 memfn.wr8[0xa8000 >> 15] = mem9821_b0w;                  memfn.wr8[0xa8000 >> 15] = memvga0_wr8;
                 memfn.wr8[0xb0000 >> 15] = mem9821_b0w;                  memfn.wr8[0xb0000 >> 15] = memvga0_wr8;
                 memfn.wr8[0xb8000 >> 15] = i286_wn;                  memfn.wr8[0xb8000 >> 15] = memnc_wr8;
                 memfn.wr8[0xe0000 >> 15] = mem9821_b2w;                  memfn.wr8[0xe0000 >> 15] = memvgaio_wr8;
   
                 memfn.rd16[0xa8000 >> 15] = mem9821_b0rw;                  memfn.rd16[0xa8000 >> 15] = memvga0_rd16;
                 memfn.rd16[0xb0000 >> 15] = mem9821_b0rw;                  memfn.rd16[0xb0000 >> 15] = memvga0_rd16;
                 memfn.rd16[0xb8000 >> 15] = i286_nonram_rw;                  memfn.rd16[0xb8000 >> 15] = memnc_rd16;
                 memfn.rd16[0xe0000 >> 15] = mem9821_b2rw;                  memfn.rd16[0xe0000 >> 15] = memvgaio_rd16;
   
                 memfn.wr16[0xa8000 >> 15] = mem9821_b0ww;                  memfn.wr16[0xa8000 >> 15] = memvga0_wr16;
                 memfn.wr16[0xb0000 >> 15] = mem9821_b0ww;                  memfn.wr16[0xb0000 >> 15] = memvga0_wr16;
                 memfn.wr16[0xb8000 >> 15] = i286w_wn;                  memfn.wr16[0xb8000 >> 15] = memnc_wr16;
                 memfn.wr16[0xe0000 >> 15] = mem9821_b2ww;                  memfn.wr16[0xe0000 >> 15] = memvgaio_wr16;
         }          }
 #endif  #endif
 }  }
Line 841  REG8 MEMCALL i286_memoryread(UINT32 addr Line 267  REG8 MEMCALL i286_memoryread(UINT32 addr
                 }                  }
 #if defined(SUPPORT_PC9821)  #if defined(SUPPORT_PC9821)
                 else if ((addr >= 0x00f00000) && (addr < 0x00f80000)) {                  else if ((addr >= 0x00f00000) && (addr < 0x00f80000)) {
                         return(mem9821_r(addr));                          return(memvgaf_rd8(addr));
                 }                  }
                 else if ((addr >= 0xfff00000) && (addr < 0xfff80000)) {                  else if ((addr >= 0xfff00000) && (addr < 0xfff80000)) {
                         return(mem9821_r(addr));                          return(memvgaf_rd8(addr));
                 }                  }
 #endif  #endif
                 else {                  else {
Line 876  REG16 MEMCALL i286_memoryread_w(UINT32 a Line 302  REG16 MEMCALL i286_memoryread_w(UINT32 a
                         }                          }
 #if defined(SUPPORT_PC9821)  #if defined(SUPPORT_PC9821)
                         else if ((addr >= 0x00f00000) && (addr < 0x00f80000)) {                          else if ((addr >= 0x00f00000) && (addr < 0x00f80000)) {
                                 return(mem9821_rw(addr));                                  return(memvgaf_rd16(addr));
                         }                          }
                         else if ((addr >= 0xfff00000) && (addr < 0xfff80000)) {                          else if ((addr >= 0xfff00000) && (addr < 0xfff80000)) {
                                 return(mem9821_rw(addr));                                  return(memvgaf_rd16(addr));
                         }                          }
 #endif  #endif
                         else {                          else {
Line 939  void MEMCALL i286_memorywrite(UINT32 add Line 365  void MEMCALL i286_memorywrite(UINT32 add
                 }                  }
 #if defined(SUPPORT_PC9821)  #if defined(SUPPORT_PC9821)
                 else if ((addr >= 0x00f00000) && (addr < 0x00f80000)) {                  else if ((addr >= 0x00f00000) && (addr < 0x00f80000)) {
                         mem9821_w(addr, value);                          memvgaf_wr8(addr, value);
                 }                  }
                 else if ((addr >= 0xfff00000) && (addr < 0xfff80000)) {                  else if ((addr >= 0xfff00000) && (addr < 0xfff80000)) {
                         mem9821_w(addr, value);                          memvgaf_wr8(addr, value);
                 }                  }
 #endif  #endif
                 else {                  else {
Line 972  void MEMCALL i286_memorywrite_w(UINT32 a Line 398  void MEMCALL i286_memorywrite_w(UINT32 a
                         }                          }
 #if defined(SUPPORT_PC9821)  #if defined(SUPPORT_PC9821)
                         else if ((addr >= 0x00f00000) && (addr < 0x00f80000)) {                          else if ((addr >= 0x00f00000) && (addr < 0x00f80000)) {
                                 mem9821_ww(addr, value);                                  memvgaf_wr16(addr, value);
                         }                          }
                         else if ((addr >= 0xfff00000) && (addr < 0xfff80000)) {                          else if ((addr >= 0xfff00000) && (addr < 0xfff80000)) {
                                 mem9821_ww(addr, value);                                  memvgaf_wr16(addr, value);
                         }                          }
 #endif  #endif
                         else {                          else {
Line 1306  void MEMCALL meml_write(UINT32 address,  Line 732  void MEMCALL meml_write(UINT32 address, 
                 }                  }
         }          }
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