ADDA

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アドレス加算 (あっどえー)

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ADDA.W <ea>,Aq

68000/68010/68020/68030/68040/68060 の命令

命令コード

アドレス	15	14	13	12	11	10	9	8	7	6	5	4	3	2	1	0
+0	1	1	0	1	レジスタq			0	1	1	モード			レジスタr

アドレッシングモードと実行時間

モード			レジスタr			<ea>	68000	68010	68020	68030	68040	68060
0	0	0	r			Dr	8(1/0)	8(1/0)	🚧	🚧	🚧	🚧
		1				Ar
	1	0				(Ar)	12(2/0)	12(2/0)
		1				(Ar)+
1	0	0				-(Ar)	14(2/0)	14(2/0)
		1				(d16,Ar)	16(3/0)	16(3/0)
	1	0				(d8,Ar,Xn)	18(3/0)	18(3/0)	-	-	-	-
						(d8,Ar,Xn*sf)	-	-	🚧	🚧	🚧	🚧
						(bd,Ar,Xn*sf)
						([bd,Ar,Xn*sf],od)
						([bd,Ar],Xn*sf,od)
		1	0	0	0	(xxx).W	16(3/0)	16(3/0)
					1	(xxx).L	20(4/0)	20(4/0)
				1	0	(d16,PC)	16(3/0)	16(3/0)
					1	(d8,PC,Xn)	18(3/0)	18(3/0)	-	-	-	-
						(d8,PC,Xn*sf)	-	-	🚧	🚧	🚧	🚧
						(bd,PC,Xn*sf)
						([bd,PC,Xn*sf],od)
						([bd,PC],Xn*sf,od)
			1	0	0	#<data>	12(2/0)	12(2/0)

コンディションコード

フラグ	入力	出力
X	使用しない	変化しない
N
Z
V
C

解説

1. <ea> が指すワード(Dr のとき下位ワード)を読み出して Yw とします。
2. Yw をロングワードに符号拡張したものを Yl とします。
3. Aq の全体を読み出して Xl とします。
4. Xl に Yl を足した結果を Zl とします。
5. Zl を Aq の全体へ書き込みます。

オペレーションサイズはワードですが Aq の全体が変化します。

フラグは変化しません。

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ADDA.L <ea>,Aq

68000/68010/68020/68030/68040/68060 の命令

命令コード

アドレス	15	14	13	12	11	10	9	8	7	6	5	4	3	2	1	0
+0	1	1	0	1	レジスタq			1	1	1	モード			レジスタr

アドレッシングモードと実行時間

モード			レジスタr			<ea>	68000	68010	68020	68030	68040	68060
0	0	0	r			Dr	8(1/0)	8(1/0)	🚧	🚧	🚧	🚧
		1				Ar
	1	0				(Ar)	14(3/0)	14(3/0)
		1				(Ar)+
1	0	0				-(Ar)	16(3/0)	16(3/0)
		1				(d16,Ar)	18(4/0)	18(4/0)
	1	0				(d8,Ar,Xn)	20(4/0)	20(4/0)	-	-	-	-
						(d8,Ar,Xn*sf)	-	-	🚧	🚧	🚧	🚧
						(bd,Ar,Xn*sf)
						([bd,Ar,Xn*sf],od)
						([bd,Ar],Xn*sf,od)
		1	0	0	0	(xxx).W	18(4/0)	18(4/0)
					1	(xxx).L	22(5/0)	22(5/0)
				1	0	(d16,PC)	18(4/0)	18(4/0)
					1	(d8,PC,Xn)	20(4/0)	20(4/0)	-	-	-	-
						(d8,PC,Xn*sf)	-	-	🚧	🚧	🚧	🚧
						(bd,PC,Xn*sf)
						([bd,PC,Xn*sf],od)
						([bd,PC],Xn*sf,od)
			1	0	0	#<data>	16(3/0)	16(3/0)

コンディションコード

フラグ	入力	出力
X	使用しない	変化しない
N
Z
V
C

解説

1. <ea> が指すロングワード(Dr のとき全体)を読み出して Yl とします。
2. Aq の全体を読み出して Xl とします。
3. Xl に Yl を足した結果を Zl とします。
4. Zl を Aq の全体へ書き込みます。

フラグは変化しません。